多項(xiàng)選擇題時序邏輯電路由()兩部分組成。
A.集成定時器
B.組合邏輯電路
C.存儲電路
D.脈沖產(chǎn)生電路
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1.多項(xiàng)選擇題時序邏輯電路的設(shè)計(jì)過程中除了有建立最原始的狀態(tài)轉(zhuǎn)換圖還有()。
A.進(jìn)行狀態(tài)編碼
B.進(jìn)行電路設(shè)計(jì)
C.列出真值表
D.畫出邏輯圖
2.多項(xiàng)選擇題在用集成計(jì)數(shù)器進(jìn)行電路設(shè)計(jì)時常用的方法有()。
A.級連法
B.置位法
C.復(fù)位法
D.擴(kuò)展法
3.多項(xiàng)選擇題觸發(fā)器是存儲電路的基本元件,根據(jù)觸發(fā)器時鐘端的連接方式,把時序邏輯電路分為()。
A.同步時序電路
B.組合邏輯電路
C.觸發(fā)器電路
D.異步時序電路
4.多項(xiàng)選擇題移位寄存器可以實(shí)現(xiàn)()。
A.并/串轉(zhuǎn)換
B.數(shù)據(jù)存儲
C.串/并轉(zhuǎn)換
D.數(shù)據(jù)運(yùn)算
5.多項(xiàng)選擇題下列邏輯電路中為時序邏輯電路的是()。
A.變量譯碼器
B.加法器
C.數(shù)碼寄存器
D.計(jì)數(shù)器
最新試題
TTL與非門輸出高電平的參數(shù)規(guī)范值是()
題型:單項(xiàng)選擇題
什么是觸發(fā)器的不定狀態(tài),如何避免不定狀態(tài)的出現(xiàn)?
題型:問答題
什么是觸發(fā)器的空翻現(xiàn)象,如何避免空翻?
題型:問答題
以下代碼中為無權(quán)碼的為()。
題型:單項(xiàng)選擇題
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號,要求輸入每變化20mV,輸出信號的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。
題型:單項(xiàng)選擇題
一個兩輸入端的門電路,當(dāng)輸入為10時,輸出不是1的門電路為()
題型:單項(xiàng)選擇題
要使JK觸發(fā)器的輸出Q從1就成0,它的輸入信號JK就為()。
題型:單項(xiàng)選擇題
小容量RAM內(nèi)部存儲矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為()
題型:單項(xiàng)選擇題
一個16選一的數(shù)據(jù)選擇器,其地址輸入(選擇控制輸入)端有()個。
題型:單項(xiàng)選擇題
TTL與非門輸出低電平的參數(shù)規(guī)范值是()
題型:單項(xiàng)選擇題