問答題簡述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。
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1.單項(xiàng)選擇題用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個（）。
A.非門
B.與非門
C.或門
D.或非門
2.單項(xiàng)選擇題利用2個74LS138和1個非門，可以擴(kuò)展得到1個（）線譯碼器。
A.2-4
B.3-8
C.4-16
D.無法確定
3.單項(xiàng)選擇題10-4線優(yōu)先編碼器允許同時輸入（）路編碼信號。
A.1
B.9
C.10
D.多
4.單項(xiàng)選擇題TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是（）。
A.20μA
B.40μA
C.1.6mA
D.16mA
5.單項(xiàng)選擇題TTL與非門閾值電壓UT的典型值是（）
A.0.4V
B.1.4V
C.2V
D.2.4V
最新試題
一個VHDL模塊是否必須有一個實(shí)體和一個結(jié)構(gòu)體？是否可以有多個實(shí)體和結(jié)構(gòu)體？簡述它們的作用。
題型：問答題
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對轉(zhuǎn)換精度的影響。
題型：單項(xiàng)選擇題
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個（）。
題型：單項(xiàng)選擇題
基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài)，所以它不能被稱為（）觸發(fā)器。
題型：單項(xiàng)選擇題
根據(jù)什么判斷簡單電路中的險象存在？
題型：問答題
27系列EPROM存儲的數(shù)據(jù)是（）可擦除的。
題型：單項(xiàng)選擇題
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號，要求輸入每變化20mV，輸出信號的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
題型：單項(xiàng)選擇題
TTL與非門閾值電壓UT的典型值是（）
題型：單項(xiàng)選擇題
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
題型：問答題
TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
題型：單項(xiàng)選擇題