單項(xiàng)選擇題用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù),需要增加若干個(gè)()。

A.非門(mén)
B.與非門(mén)
C.或門(mén)
D.或非門(mén)


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3.單項(xiàng)選擇題TTL與非門(mén)輸入短路電流IIS的參數(shù)規(guī)范值是()。

A.20μA
B.40μA
C.1.6mA
D.16mA

4.單項(xiàng)選擇題TTL與非門(mén)閾值電壓UT的典型值是()

A.0.4V
B.1.4V
C.2V
D.2.4V

5.單項(xiàng)選擇題TTL與非門(mén)輸出低電平的參數(shù)規(guī)范值是()

A.Uol≤0.3V
B.Uol≥0.3V
C.Uol≤0.4V
D.Uol=0.8V

6.單項(xiàng)選擇題TTL與非門(mén)輸出高電平的參數(shù)規(guī)范值是()

A.Uoh≥1.4V
B.Uoh≥2.4V
C.Uoh≥3.3V
D.Uoh=3.6V

10.單項(xiàng)選擇題在VHDL語(yǔ)言中,變量的賦值符是()。

A.=
B.:=
C.<=
D.==

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ROM可以用來(lái)存儲(chǔ)程序、表格和大量固定數(shù)據(jù),但它不可以用來(lái)實(shí)現(xiàn)()。

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如果把D觸發(fā)器的輸出Q反饋連接到輸入D,則輸出Q的脈沖波形的頻率為CP脈沖頻率f的()。

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根據(jù)什么判斷簡(jiǎn)單電路中的險(xiǎn)象存在?

題型:?jiǎn)柎痤}

兩個(gè)與非門(mén)構(gòu)成的基本RS觸發(fā)器,當(dāng)Q=1、Q=0時(shí),兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)()。

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TTL與非門(mén)閾值電壓UT的典型值是()

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如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),要求輸入每變化20mV,輸出信號(hào)的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。

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簡(jiǎn)述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。

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采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是()可擦除的。

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