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問答題簡(jiǎn)述VHDL語(yǔ)言的主要優(yōu)點(diǎn)。

1.單項(xiàng)選擇題在VHDL語(yǔ)言中，變量的賦值符是（）。

A.=
B.：=
C.＜=
D.==

2.單項(xiàng)選擇題在VHDL語(yǔ)言中，信號(hào)賦值語(yǔ)句使用的代入符是（）

A.=
B.：=
C.＜=
D.==

3.單項(xiàng)選擇題在VHDL語(yǔ)言中，不同類型的數(shù)據(jù)是（）的。

A.可以進(jìn)行運(yùn)算和直接代入
B.不能進(jìn)行運(yùn)算和直接代入
C.不能進(jìn)行運(yùn)算但可以直接代入
D.可以進(jìn)行運(yùn)算但不能直接代入

4.單項(xiàng)選擇題VHDL中的各種邏輯運(yùn)算中，運(yùn)算符（）的優(yōu)先級(jí)別最高。

A.AND
B.OR
C.XOR
D.NOT

5.單項(xiàng)選擇題結(jié)構(gòu)體中的變量應(yīng)在VHDL程序中（）部分給予說明。

A.結(jié)構(gòu)體對(duì)應(yīng)的實(shí)體的端口表中
B.結(jié)構(gòu)體中關(guān)鍵詞BEGIN前
C.結(jié)構(gòu)體中關(guān)鍵詞BEGIN后
D.程序包（PACKAGE）